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/* SPDX-License-Identifier: GPL-2.0 */
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/*
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* Copyright (c) 2019 MediaTek Inc.
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*/
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#ifndef __HELIO_DVFSRC_OPP_MT6853_H
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#define __HELIO_DVFSRC_OPP_MT6853_H
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#include <linux/soc/mediatek/mtk-pm-qos.h>
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int ddr_level_to_step(int opp);
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enum ddr_opp {
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DDR_OPP_0 = 0,
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DDR_OPP_1,
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DDR_OPP_2,
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DDR_OPP_3,
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DDR_OPP_4,
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DDR_OPP_5,
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DDR_OPP_6,
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DDR_OPP_NUM,
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DDR_OPP_UNREQ = MTK_PM_QOS_DDR_OPP_DEFAULT_VALUE,
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};
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enum vcore_opp {
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VCORE_OPP_0 = 0,
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VCORE_OPP_1,
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VCORE_OPP_2,
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|
VCORE_OPP_3,
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||
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|
VCORE_OPP_NUM,
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||
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|
VCORE_OPP_UNREQ = MTK_PM_QOS_VCORE_OPP_DEFAULT_VALUE,
|
||
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|
};
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enum vcore_dvfs_opp {
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VCORE_DVFS_OPP_0 = 0,
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VCORE_DVFS_OPP_1,
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VCORE_DVFS_OPP_2,
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VCORE_DVFS_OPP_3,
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VCORE_DVFS_OPP_4,
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VCORE_DVFS_OPP_5,
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VCORE_DVFS_OPP_6,
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VCORE_DVFS_OPP_7,
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VCORE_DVFS_OPP_8,
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VCORE_DVFS_OPP_9,
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VCORE_DVFS_OPP_10,
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VCORE_DVFS_OPP_11,
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VCORE_DVFS_OPP_12,
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VCORE_DVFS_OPP_13,
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VCORE_DVFS_OPP_14,
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VCORE_DVFS_OPP_15,
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VCORE_DVFS_OPP_16,
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VCORE_DVFS_OPP_17,
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VCORE_DVFS_OPP_18,
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VCORE_DVFS_OPP_19,
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VCORE_DVFS_OPP_20,
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VCORE_DVFS_OPP_NUM,
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VCORE_DVFS_OPP_UNREQ = MTK_PM_QOS_VCORE_DVFS_FORCE_OPP_DEFAULT_VALUE,
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|
};
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#endif /* __HELIO_DVFSRC_OPP_MT6853_H */
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